-
Notifications
You must be signed in to change notification settings - Fork 0
/
Copy pathDE2_Audio_Example.fit.rpt
1364 lines (1311 loc) · 182 KB
/
DE2_Audio_Example.fit.rpt
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
121
122
123
124
125
126
127
128
129
130
131
132
133
134
135
136
137
138
139
140
141
142
143
144
145
146
147
148
149
150
151
152
153
154
155
156
157
158
159
160
161
162
163
164
165
166
167
168
169
170
171
172
173
174
175
176
177
178
179
180
181
182
183
184
185
186
187
188
189
190
191
192
193
194
195
196
197
198
199
200
201
202
203
204
205
206
207
208
209
210
211
212
213
214
215
216
217
218
219
220
221
222
223
224
225
226
227
228
229
230
231
232
233
234
235
236
237
238
239
240
241
242
243
244
245
246
247
248
249
250
251
252
253
254
255
256
257
258
259
260
261
262
263
264
265
266
267
268
269
270
271
272
273
274
275
276
277
278
279
280
281
282
283
284
285
286
287
288
289
290
291
292
293
294
295
296
297
298
299
300
301
302
303
304
305
306
307
308
309
310
311
312
313
314
315
316
317
318
319
320
321
322
323
324
325
326
327
328
329
330
331
332
333
334
335
336
337
338
339
340
341
342
343
344
345
346
347
348
349
350
351
352
353
354
355
356
357
358
359
360
361
362
363
364
365
366
367
368
369
370
371
372
373
374
375
376
377
378
379
380
381
382
383
384
385
386
387
388
389
390
391
392
393
394
395
396
397
398
399
400
401
402
403
404
405
406
407
408
409
410
411
412
413
414
415
416
417
418
419
420
421
422
423
424
425
426
427
428
429
430
431
432
433
434
435
436
437
438
439
440
441
442
443
444
445
446
447
448
449
450
451
452
453
454
455
456
457
458
459
460
461
462
463
464
465
466
467
468
469
470
471
472
473
474
475
476
477
478
479
480
481
482
483
484
485
486
487
488
489
490
491
492
493
494
495
496
497
498
499
500
501
502
503
504
505
506
507
508
509
510
511
512
513
514
515
516
517
518
519
520
521
522
523
524
525
526
527
528
529
530
531
532
533
534
535
536
537
538
539
540
541
542
543
544
545
546
547
548
549
550
551
552
553
554
555
556
557
558
559
560
561
562
563
564
565
566
567
568
569
570
571
572
573
574
575
576
577
578
579
580
581
582
583
584
585
586
587
588
589
590
591
592
593
594
595
596
597
598
599
600
601
602
603
604
605
606
607
608
609
610
611
612
613
614
615
616
617
618
619
620
621
622
623
624
625
626
627
628
629
630
631
632
633
634
635
636
637
638
639
640
641
642
643
644
645
646
647
648
649
650
651
652
653
654
655
656
657
658
659
660
661
662
663
664
665
666
667
668
669
670
671
672
673
674
675
676
677
678
679
680
681
682
683
684
685
686
687
688
689
690
691
692
693
694
695
696
697
698
699
700
701
702
703
704
705
706
707
708
709
710
711
712
713
714
715
716
717
718
719
720
721
722
723
724
725
726
727
728
729
730
731
732
733
734
735
736
737
738
739
740
741
742
743
744
745
746
747
748
749
750
751
752
753
754
755
756
757
758
759
760
761
762
763
764
765
766
767
768
769
770
771
772
773
774
775
776
777
778
779
780
781
782
783
784
785
786
787
788
789
790
791
792
793
794
795
796
797
798
799
800
801
802
803
804
805
806
807
808
809
810
811
812
813
814
815
816
817
818
819
820
821
822
823
824
825
826
827
828
829
830
831
832
833
834
835
836
837
838
839
840
841
842
843
844
845
846
847
848
849
850
851
852
853
854
855
856
857
858
859
860
861
862
863
864
865
866
867
868
869
870
871
872
873
874
875
876
877
878
879
880
881
882
883
884
885
886
887
888
889
890
891
892
893
894
895
896
897
898
899
900
901
902
903
904
905
906
907
908
909
910
911
912
913
914
915
916
917
918
919
920
921
922
923
924
925
926
927
928
929
930
931
932
933
934
935
936
937
938
939
940
941
942
943
944
945
946
947
948
949
950
951
952
953
954
955
956
957
958
959
960
961
962
963
964
965
966
967
968
969
970
971
972
973
974
975
976
977
978
979
980
981
982
983
984
985
986
987
988
989
990
991
992
993
994
995
996
997
998
999
1000
Fitter report for DE2_Audio_Example
Thu Mar 21 19:20:41 2019
Quartus Prime Version 16.0.0 Build 211 04/27/2016 SJ Lite Edition
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Parallel Compilation
5. Ignored Assignments
6. Fitter Resource Usage Summary
7. Input Pins
8. Output Pins
9. Bidir Pins
10. Dual Purpose and Dedicated Pins
11. I/O Bank Usage
12. All Package Pins
13. PLL Summary
14. PLL Usage
15. Fitter Resource Utilization by Entity
16. Delay Chain Summary
17. Pad To Core Delay Chain Fanout
18. Control Signals
19. Non-Global High Fan-Out Signals
20. Fitter RAM Summary
21. Fitter Device Options
22. Operating Settings and Conditions
23. Fitter Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2016 Altera Corporation. All rights reserved.
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
(including device programming or simulation files), and any
associated documentation or information are expressly subject
to the terms and conditions of the Altera Program License
Subscription Agreement, the Altera Quartus Prime License Agreement,
the Altera MegaCore Function License Agreement, or other
applicable license agreement, including, without limitation,
that your use is for the sole purpose of programming logic
devices manufactured by Altera and sold by Altera or its
authorized distributors. Please refer to the applicable
agreement for further details.
+----------------------------------------------------------------------------------+
; Fitter Summary ;
+------------------------------------+---------------------------------------------+
; Fitter Status ; Failed - Thu Mar 21 19:20:41 2019 ;
; Quartus Prime Version ; 16.0.0 Build 211 04/27/2016 SJ Lite Edition ;
; Revision Name ; DE2_Audio_Example ;
; Top-level Entity Name ; DE2_Audio_Example ;
; Family ; Cyclone IV E ;
; Device ; EP4CE6E22C6 ;
; Timing Models ; Final ;
; Total logic elements ; 616 / 6,272 ( 10 % ) ;
; Total combinational functions ; 592 / 6,272 ( 9 % ) ;
; Dedicated logic registers ; 317 / 6,272 ( 5 % ) ;
; Total registers ; 317 ;
; Total pins ; 18 / 92 ( 20 % ) ;
; Total virtual pins ; 0 ;
; Total memory bits ; 16,384 / 276,480 ( 6 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 30 ( 0 % ) ;
; Total PLLs ; 1 / 2 ( 50 % ) ;
+------------------------------------+---------------------------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+----------------------------------------------------------------------------+---------------------------------------+---------------------------------------+
; Option ; Setting ; Default Value ;
+----------------------------------------------------------------------------+---------------------------------------+---------------------------------------+
; Device ; Auto ; ;
; Fit Attempts to Skip ; 0 ; 0.0 ;
; Use smart compilation ; Off ; Off ;
; Maximum processors allowed for parallel compilation ; 1 ; 1 ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On ; On ;
; Enable compact report table ; Off ; Off ;
; Auto Merge PLLs ; On ; On ;
; Router Timing Optimization Level ; Normal ; Normal ;
; Perform Clocking Topology Analysis During Routing ; Off ; Off ;
; Placement Effort Multiplier ; 1.0 ; 1.0 ;
; Router Effort Multiplier ; 1.0 ; 1.0 ;
; Optimize Hold Timing ; All Paths ; All Paths ;
; Optimize Multi-Corner Timing ; On ; On ;
; PowerPlay Power Optimization During Fitting ; Normal compilation ; Normal compilation ;
; SSN Optimization ; Off ; Off ;
; Optimize Timing ; Normal compilation ; Normal compilation ;
; Optimize Timing for ECOs ; Off ; Off ;
; Regenerate Full Fit Report During ECO Compiles ; Off ; Off ;
; Optimize IOC Register Placement for Timing ; Normal ; Normal ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Periphery to Core Placement and Routing Optimization ; Off ; Off ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Packed Registers ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Delay Chains for High Fanout Input Pins ; Off ; Off ;
; Allow Single-ended Buffer for Differential-XSTL Input ; Off ; Off ;
; Treat Bidirectional Pin as Output Pin ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Fitting ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Performance ; Off ; Off ;
; Perform Register Duplication for Performance ; Off ; Off ;
; Perform Logic to Memory Mapping for Fitting ; Off ; Off ;
; Perform Register Retiming for Performance ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Reserve all unused pins ; As input tri-stated with weak pull-up ; As input tri-stated with weak pull-up ;
; Synchronizer Identification ; Auto ; Auto ;
; Enable Beneficial Skew Optimization ; On ; On ;
; Optimize Design for Metastability ; On ; On ;
; Force Fitter to Avoid Periphery Placement Warnings ; Off ; Off ;
; Enable input tri-state on active configuration pins in user mode ; Off ; Off ;
+----------------------------------------------------------------------------+---------------------------------------+---------------------------------------+
Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation ;
+----------------------------+--------+
; Processors ; Number ;
+----------------------------+--------+
; Number detected on machine ; 4 ;
; Maximum allowed ; 1 ;
+----------------------------+--------+
+----------------------------------------------------------------------------------------------+
; Ignored Assignments ;
+----------+----------------+--------------+------------------+---------------+----------------+
; Name ; Ignored Entity ; Ignored From ; Ignored To ; Ignored Value ; Ignored Source ;
+----------+----------------+--------------+------------------+---------------+----------------+
; Location ; ; ; CLOCK2_50 ; PIN_AG14 ; QSF Assignment ;
; Location ; ; ; CLOCK3_50 ; PIN_AG15 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[0] ; PIN_R6 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[10] ; PIN_R5 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[11] ; PIN_AA5 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[12] ; PIN_Y7 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[1] ; PIN_V8 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[2] ; PIN_U8 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[3] ; PIN_P1 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[4] ; PIN_V5 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[5] ; PIN_W8 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[6] ; PIN_W7 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[7] ; PIN_AA7 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[8] ; PIN_Y5 ; QSF Assignment ;
; Location ; ; ; DRAM_ADDR[9] ; PIN_Y6 ; QSF Assignment ;
; Location ; ; ; DRAM_BA[0] ; PIN_U7 ; QSF Assignment ;
; Location ; ; ; DRAM_BA[1] ; PIN_R4 ; QSF Assignment ;
; Location ; ; ; DRAM_BA_0 ; PIN_AE2 ; QSF Assignment ;
; Location ; ; ; DRAM_BA_1 ; PIN_AE3 ; QSF Assignment ;
; Location ; ; ; DRAM_CAS_N ; PIN_V7 ; QSF Assignment ;
; Location ; ; ; DRAM_CKE ; PIN_AA6 ; QSF Assignment ;
; Location ; ; ; DRAM_CLK ; PIN_AE5 ; QSF Assignment ;
; Location ; ; ; DRAM_CS_N ; PIN_T4 ; QSF Assignment ;
; Location ; ; ; DRAM_DQM[0] ; PIN_U2 ; QSF Assignment ;
; Location ; ; ; DRAM_DQM[1] ; PIN_W4 ; QSF Assignment ;
; Location ; ; ; DRAM_DQM[2] ; PIN_K8 ; QSF Assignment ;
; Location ; ; ; DRAM_DQM[3] ; PIN_N8 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[0] ; PIN_W3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[10] ; PIN_AB1 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[11] ; PIN_AA3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[12] ; PIN_AB2 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[13] ; PIN_AC1 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[14] ; PIN_AB3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[15] ; PIN_AC2 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[16] ; PIN_M8 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[17] ; PIN_L8 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[18] ; PIN_P2 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[19] ; PIN_N3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[1] ; PIN_W2 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[20] ; PIN_N4 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[21] ; PIN_M4 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[22] ; PIN_M7 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[23] ; PIN_L7 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[24] ; PIN_U5 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[25] ; PIN_R7 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[26] ; PIN_R1 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[27] ; PIN_R2 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[28] ; PIN_R3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[29] ; PIN_T3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[2] ; PIN_V4 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[30] ; PIN_U4 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[31] ; PIN_U1 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[3] ; PIN_W1 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[4] ; PIN_V3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[5] ; PIN_V2 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[6] ; PIN_V1 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[7] ; PIN_U3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[8] ; PIN_Y3 ; QSF Assignment ;
; Location ; ; ; DRAM_DQ[9] ; PIN_Y4 ; QSF Assignment ;
; Location ; ; ; DRAM_LDQM ; PIN_AD2 ; QSF Assignment ;
; Location ; ; ; DRAM_RAS_N ; PIN_U6 ; QSF Assignment ;
; Location ; ; ; DRAM_UDQM ; PIN_Y5 ; QSF Assignment ;
; Location ; ; ; DRAM_WE_N ; PIN_V6 ; QSF Assignment ;
; Location ; ; ; EEP_I2C_SCLK ; PIN_D14 ; QSF Assignment ;
; Location ; ; ; EEP_I2C_SDAT ; PIN_E14 ; QSF Assignment ;
; Location ; ; ; ENET0_GTX_CLK ; PIN_A17 ; QSF Assignment ;
; Location ; ; ; ENET0_INT_N ; PIN_A21 ; QSF Assignment ;
; Location ; ; ; ENET0_LINK100 ; PIN_C14 ; QSF Assignment ;
; Location ; ; ; ENET0_MDC ; PIN_C20 ; QSF Assignment ;
; Location ; ; ; ENET0_MDIO ; PIN_B21 ; QSF Assignment ;
; Location ; ; ; ENET0_RESET_N ; PIN_C19 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_CLK ; PIN_A15 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_COL ; PIN_E15 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_CRS ; PIN_D15 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_DATA[0] ; PIN_C16 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_DATA[1] ; PIN_D16 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_DATA[2] ; PIN_D17 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_DATA[3] ; PIN_C15 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_DV ; PIN_C17 ; QSF Assignment ;
; Location ; ; ; ENET0_RX_ER ; PIN_D18 ; QSF Assignment ;
; Location ; ; ; ENET0_TX_CLK ; PIN_B17 ; QSF Assignment ;
; Location ; ; ; ENET0_TX_DATA[0] ; PIN_C18 ; QSF Assignment ;
; Location ; ; ; ENET0_TX_DATA[1] ; PIN_D19 ; QSF Assignment ;
; Location ; ; ; ENET0_TX_DATA[2] ; PIN_A19 ; QSF Assignment ;
; Location ; ; ; ENET0_TX_DATA[3] ; PIN_B19 ; QSF Assignment ;
; Location ; ; ; ENET0_TX_EN ; PIN_A18 ; QSF Assignment ;
; Location ; ; ; ENET0_TX_ER ; PIN_B18 ; QSF Assignment ;
; Location ; ; ; ENET1_GTX_CLK ; PIN_C23 ; QSF Assignment ;
; Location ; ; ; ENET1_INT_N ; PIN_D24 ; QSF Assignment ;
; Location ; ; ; ENET1_LINK100 ; PIN_D13 ; QSF Assignment ;
; Location ; ; ; ENET1_MDC ; PIN_D23 ; QSF Assignment ;
; Location ; ; ; ENET1_MDIO ; PIN_D25 ; QSF Assignment ;
; Location ; ; ; ENET1_RESET_N ; PIN_D22 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_CLK ; PIN_B15 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_COL ; PIN_B22 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_CRS ; PIN_D20 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_DATA[0] ; PIN_B23 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_DATA[1] ; PIN_C21 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_DATA[2] ; PIN_A23 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_DATA[3] ; PIN_D21 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_DV ; PIN_A22 ; QSF Assignment ;
; Location ; ; ; ENET1_RX_ER ; PIN_C24 ; QSF Assignment ;
; Location ; ; ; ENET1_TX_CLK ; PIN_C22 ; QSF Assignment ;
; Location ; ; ; ENET1_TX_DATA[0] ; PIN_C25 ; QSF Assignment ;
; Location ; ; ; ENET1_TX_DATA[1] ; PIN_A26 ; QSF Assignment ;
; Location ; ; ; ENET1_TX_DATA[2] ; PIN_B26 ; QSF Assignment ;
; Location ; ; ; ENET1_TX_DATA[3] ; PIN_C26 ; QSF Assignment ;
; Location ; ; ; ENET1_TX_EN ; PIN_B25 ; QSF Assignment ;
; Location ; ; ; ENET1_TX_ER ; PIN_A25 ; QSF Assignment ;
; Location ; ; ; ENET_CLK ; PIN_B24 ; QSF Assignment ;
; Location ; ; ; ENET_CMD ; PIN_A21 ; QSF Assignment ;
; Location ; ; ; ENET_CS_N ; PIN_A23 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[0] ; PIN_D17 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[10] ; PIN_C19 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[11] ; PIN_D19 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[12] ; PIN_B19 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[13] ; PIN_A19 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[14] ; PIN_E18 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[15] ; PIN_D18 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[1] ; PIN_C17 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[2] ; PIN_B18 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[3] ; PIN_A18 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[4] ; PIN_B17 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[5] ; PIN_A17 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[6] ; PIN_B16 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[7] ; PIN_B15 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[8] ; PIN_B20 ; QSF Assignment ;
; Location ; ; ; ENET_DATA[9] ; PIN_A20 ; QSF Assignment ;
; Location ; ; ; ENET_INT ; PIN_B21 ; QSF Assignment ;
; Location ; ; ; ENET_RD_N ; PIN_A22 ; QSF Assignment ;
; Location ; ; ; ENET_RST_N ; PIN_B23 ; QSF Assignment ;
; Location ; ; ; ENET_WR_N ; PIN_B22 ; QSF Assignment ;
; Location ; ; ; EXT_CLOCK ; PIN_P26 ; QSF Assignment ;
; Location ; ; ; EXT_IO[0] ; PIN_J10 ; QSF Assignment ;
; Location ; ; ; EXT_IO[1] ; PIN_J14 ; QSF Assignment ;
; Location ; ; ; EXT_IO[2] ; PIN_H13 ; QSF Assignment ;
; Location ; ; ; EXT_IO[3] ; PIN_H14 ; QSF Assignment ;
; Location ; ; ; EXT_IO[4] ; PIN_F14 ; QSF Assignment ;
; Location ; ; ; EXT_IO[5] ; PIN_E10 ; QSF Assignment ;
; Location ; ; ; EXT_IO[6] ; PIN_D9 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[0] ; PIN_AG12 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[10] ; PIN_AE9 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[11] ; PIN_AF9 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[12] ; PIN_AA10 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[13] ; PIN_AD8 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[14] ; PIN_AC8 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[15] ; PIN_Y10 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[16] ; PIN_AA8 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[17] ; PIN_AH12 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[18] ; PIN_AC12 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[19] ; PIN_AD12 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[1] ; PIN_AH7 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[20] ; PIN_AE10 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[21] ; PIN_AD10 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[22] ; PIN_AD11 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[2] ; PIN_Y13 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[3] ; PIN_Y14 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[4] ; PIN_Y12 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[5] ; PIN_AA13 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[6] ; PIN_AA12 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[7] ; PIN_AB13 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[8] ; PIN_AB12 ; QSF Assignment ;
; Location ; ; ; FL_ADDR[9] ; PIN_AB10 ; QSF Assignment ;
; Location ; ; ; FL_CE_N ; PIN_AG7 ; QSF Assignment ;
; Location ; ; ; FL_DQ[0] ; PIN_AH8 ; QSF Assignment ;
; Location ; ; ; FL_DQ[1] ; PIN_AF10 ; QSF Assignment ;
; Location ; ; ; FL_DQ[2] ; PIN_AG10 ; QSF Assignment ;
; Location ; ; ; FL_DQ[3] ; PIN_AH10 ; QSF Assignment ;
; Location ; ; ; FL_DQ[4] ; PIN_AF11 ; QSF Assignment ;
; Location ; ; ; FL_DQ[5] ; PIN_AG11 ; QSF Assignment ;
; Location ; ; ; FL_DQ[6] ; PIN_AH11 ; QSF Assignment ;
; Location ; ; ; FL_DQ[7] ; PIN_AF12 ; QSF Assignment ;
; Location ; ; ; FL_OE_N ; PIN_AG8 ; QSF Assignment ;
; Location ; ; ; FL_RESET_N ; PIN_AE11 ; QSF Assignment ;
; Location ; ; ; FL_RST_N ; PIN_AA18 ; QSF Assignment ;
; Location ; ; ; FL_RY ; PIN_Y1 ; QSF Assignment ;
; Location ; ; ; FL_WE_N ; PIN_AC10 ; QSF Assignment ;
; Location ; ; ; FL_WP_N ; PIN_AE12 ; QSF Assignment ;
; Location ; ; ; GPIO[0] ; PIN_AB22 ; QSF Assignment ;
; Location ; ; ; GPIO[10] ; PIN_AC19 ; QSF Assignment ;
; Location ; ; ; GPIO[11] ; PIN_AF16 ; QSF Assignment ;
; Location ; ; ; GPIO[12] ; PIN_AD19 ; QSF Assignment ;
; Location ; ; ; GPIO[13] ; PIN_AF15 ; QSF Assignment ;
; Location ; ; ; GPIO[14] ; PIN_AF24 ; QSF Assignment ;
; Location ; ; ; GPIO[15] ; PIN_AE21 ; QSF Assignment ;
; Location ; ; ; GPIO[16] ; PIN_AF25 ; QSF Assignment ;
; Location ; ; ; GPIO[17] ; PIN_AC22 ; QSF Assignment ;
; Location ; ; ; GPIO[18] ; PIN_AE22 ; QSF Assignment ;
; Location ; ; ; GPIO[19] ; PIN_AF21 ; QSF Assignment ;
; Location ; ; ; GPIO[1] ; PIN_AC15 ; QSF Assignment ;
; Location ; ; ; GPIO[20] ; PIN_AF22 ; QSF Assignment ;
; Location ; ; ; GPIO[21] ; PIN_AD22 ; QSF Assignment ;
; Location ; ; ; GPIO[22] ; PIN_AG25 ; QSF Assignment ;
; Location ; ; ; GPIO[23] ; PIN_AD25 ; QSF Assignment ;
; Location ; ; ; GPIO[24] ; PIN_AH25 ; QSF Assignment ;
; Location ; ; ; GPIO[25] ; PIN_AE25 ; QSF Assignment ;
; Location ; ; ; GPIO[26] ; PIN_AG22 ; QSF Assignment ;
; Location ; ; ; GPIO[27] ; PIN_AE24 ; QSF Assignment ;
; Location ; ; ; GPIO[28] ; PIN_AH22 ; QSF Assignment ;
; Location ; ; ; GPIO[29] ; PIN_AF26 ; QSF Assignment ;
; Location ; ; ; GPIO[2] ; PIN_AB21 ; QSF Assignment ;
; Location ; ; ; GPIO[30] ; PIN_AE20 ; QSF Assignment ;
; Location ; ; ; GPIO[31] ; PIN_AG23 ; QSF Assignment ;
; Location ; ; ; GPIO[32] ; PIN_AF20 ; QSF Assignment ;
; Location ; ; ; GPIO[33] ; PIN_AH26 ; QSF Assignment ;
; Location ; ; ; GPIO[34] ; PIN_AH23 ; QSF Assignment ;
; Location ; ; ; GPIO[35] ; PIN_AG26 ; QSF Assignment ;
; Location ; ; ; GPIO[3] ; PIN_Y17 ; QSF Assignment ;
; Location ; ; ; GPIO[4] ; PIN_AC21 ; QSF Assignment ;
; Location ; ; ; GPIO[5] ; PIN_Y16 ; QSF Assignment ;
; Location ; ; ; GPIO[6] ; PIN_AD21 ; QSF Assignment ;
; Location ; ; ; GPIO[7] ; PIN_AE16 ; QSF Assignment ;
; Location ; ; ; GPIO[8] ; PIN_AD15 ; QSF Assignment ;
; Location ; ; ; GPIO[9] ; PIN_AE15 ; QSF Assignment ;
; Location ; ; ; GPIO_0[0] ; PIN_D25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[10] ; PIN_N18 ; QSF Assignment ;
; Location ; ; ; GPIO_0[11] ; PIN_P18 ; QSF Assignment ;
; Location ; ; ; GPIO_0[12] ; PIN_G23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[13] ; PIN_G24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[14] ; PIN_K22 ; QSF Assignment ;
; Location ; ; ; GPIO_0[15] ; PIN_G25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[16] ; PIN_H23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[17] ; PIN_H24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[18] ; PIN_J23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[19] ; PIN_J24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[1] ; PIN_J22 ; QSF Assignment ;
; Location ; ; ; GPIO_0[20] ; PIN_H25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[21] ; PIN_H26 ; QSF Assignment ;
; Location ; ; ; GPIO_0[22] ; PIN_H19 ; QSF Assignment ;
; Location ; ; ; GPIO_0[23] ; PIN_K18 ; QSF Assignment ;
; Location ; ; ; GPIO_0[24] ; PIN_K19 ; QSF Assignment ;
; Location ; ; ; GPIO_0[25] ; PIN_K21 ; QSF Assignment ;
; Location ; ; ; GPIO_0[26] ; PIN_K23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[27] ; PIN_K24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[28] ; PIN_L21 ; QSF Assignment ;
; Location ; ; ; GPIO_0[29] ; PIN_L20 ; QSF Assignment ;
; Location ; ; ; GPIO_0[2] ; PIN_E26 ; QSF Assignment ;
; Location ; ; ; GPIO_0[30] ; PIN_J25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[31] ; PIN_J26 ; QSF Assignment ;
; Location ; ; ; GPIO_0[32] ; PIN_L23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[33] ; PIN_L24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[34] ; PIN_L25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[35] ; PIN_L19 ; QSF Assignment ;
; Location ; ; ; GPIO_0[3] ; PIN_E25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[4] ; PIN_F24 ; QSF Assignment ;
; Location ; ; ; GPIO_0[5] ; PIN_F23 ; QSF Assignment ;
; Location ; ; ; GPIO_0[6] ; PIN_J21 ; QSF Assignment ;
; Location ; ; ; GPIO_0[7] ; PIN_J20 ; QSF Assignment ;
; Location ; ; ; GPIO_0[8] ; PIN_F25 ; QSF Assignment ;
; Location ; ; ; GPIO_0[9] ; PIN_F26 ; QSF Assignment ;
; Location ; ; ; GPIO_1[0] ; PIN_K25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[10] ; PIN_N24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[11] ; PIN_P24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[12] ; PIN_R25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[13] ; PIN_R24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[14] ; PIN_R20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[15] ; PIN_T22 ; QSF Assignment ;
; Location ; ; ; GPIO_1[16] ; PIN_T23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[17] ; PIN_T24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[18] ; PIN_T25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[19] ; PIN_T18 ; QSF Assignment ;
; Location ; ; ; GPIO_1[1] ; PIN_K26 ; QSF Assignment ;
; Location ; ; ; GPIO_1[20] ; PIN_T21 ; QSF Assignment ;
; Location ; ; ; GPIO_1[21] ; PIN_T20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[22] ; PIN_U26 ; QSF Assignment ;
; Location ; ; ; GPIO_1[23] ; PIN_U25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[24] ; PIN_U23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[25] ; PIN_U24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[26] ; PIN_R19 ; QSF Assignment ;
; Location ; ; ; GPIO_1[27] ; PIN_T19 ; QSF Assignment ;
; Location ; ; ; GPIO_1[28] ; PIN_U20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[29] ; PIN_U21 ; QSF Assignment ;
; Location ; ; ; GPIO_1[2] ; PIN_M22 ; QSF Assignment ;
; Location ; ; ; GPIO_1[30] ; PIN_V26 ; QSF Assignment ;
; Location ; ; ; GPIO_1[31] ; PIN_V25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[32] ; PIN_V24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[33] ; PIN_V23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[34] ; PIN_W25 ; QSF Assignment ;
; Location ; ; ; GPIO_1[35] ; PIN_W23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[3] ; PIN_M23 ; QSF Assignment ;
; Location ; ; ; GPIO_1[4] ; PIN_M19 ; QSF Assignment ;
; Location ; ; ; GPIO_1[5] ; PIN_M20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[6] ; PIN_N20 ; QSF Assignment ;
; Location ; ; ; GPIO_1[7] ; PIN_M21 ; QSF Assignment ;
; Location ; ; ; GPIO_1[8] ; PIN_M24 ; QSF Assignment ;
; Location ; ; ; GPIO_1[9] ; PIN_M25 ; QSF Assignment ;
; Location ; ; ; HEX0[0] ; PIN_G18 ; QSF Assignment ;
; Location ; ; ; HEX0[1] ; PIN_F22 ; QSF Assignment ;
; Location ; ; ; HEX0[2] ; PIN_E17 ; QSF Assignment ;
; Location ; ; ; HEX0[3] ; PIN_L26 ; QSF Assignment ;
; Location ; ; ; HEX0[4] ; PIN_L25 ; QSF Assignment ;
; Location ; ; ; HEX0[5] ; PIN_J22 ; QSF Assignment ;
; Location ; ; ; HEX0[6] ; PIN_H22 ; QSF Assignment ;
; Location ; ; ; HEX1[0] ; PIN_M24 ; QSF Assignment ;
; Location ; ; ; HEX1[1] ; PIN_Y22 ; QSF Assignment ;
; Location ; ; ; HEX1[2] ; PIN_W21 ; QSF Assignment ;
; Location ; ; ; HEX1[3] ; PIN_W22 ; QSF Assignment ;
; Location ; ; ; HEX1[4] ; PIN_W25 ; QSF Assignment ;
; Location ; ; ; HEX1[5] ; PIN_U23 ; QSF Assignment ;
; Location ; ; ; HEX1[6] ; PIN_U24 ; QSF Assignment ;
; Location ; ; ; HEX2[0] ; PIN_AA25 ; QSF Assignment ;
; Location ; ; ; HEX2[1] ; PIN_AA26 ; QSF Assignment ;
; Location ; ; ; HEX2[2] ; PIN_Y25 ; QSF Assignment ;
; Location ; ; ; HEX2[3] ; PIN_W26 ; QSF Assignment ;
; Location ; ; ; HEX2[4] ; PIN_Y26 ; QSF Assignment ;
; Location ; ; ; HEX2[5] ; PIN_W27 ; QSF Assignment ;
; Location ; ; ; HEX2[6] ; PIN_W28 ; QSF Assignment ;
; Location ; ; ; HEX3[0] ; PIN_V21 ; QSF Assignment ;
; Location ; ; ; HEX3[1] ; PIN_U21 ; QSF Assignment ;
; Location ; ; ; HEX3[2] ; PIN_AB20 ; QSF Assignment ;
; Location ; ; ; HEX3[3] ; PIN_AA21 ; QSF Assignment ;
; Location ; ; ; HEX3[4] ; PIN_AD24 ; QSF Assignment ;
; Location ; ; ; HEX3[5] ; PIN_AF23 ; QSF Assignment ;
; Location ; ; ; HEX3[6] ; PIN_Y19 ; QSF Assignment ;
; Location ; ; ; HEX4[0] ; PIN_AB19 ; QSF Assignment ;
; Location ; ; ; HEX4[1] ; PIN_AA19 ; QSF Assignment ;
; Location ; ; ; HEX4[2] ; PIN_AG21 ; QSF Assignment ;
; Location ; ; ; HEX4[3] ; PIN_AH21 ; QSF Assignment ;
; Location ; ; ; HEX4[4] ; PIN_AE19 ; QSF Assignment ;
; Location ; ; ; HEX4[5] ; PIN_AF19 ; QSF Assignment ;
; Location ; ; ; HEX4[6] ; PIN_AE18 ; QSF Assignment ;
; Location ; ; ; HEX5[0] ; PIN_AD18 ; QSF Assignment ;
; Location ; ; ; HEX5[1] ; PIN_AC18 ; QSF Assignment ;
; Location ; ; ; HEX5[2] ; PIN_AB18 ; QSF Assignment ;
; Location ; ; ; HEX5[3] ; PIN_AH19 ; QSF Assignment ;
; Location ; ; ; HEX5[4] ; PIN_AG19 ; QSF Assignment ;
; Location ; ; ; HEX5[5] ; PIN_AF18 ; QSF Assignment ;
; Location ; ; ; HEX5[6] ; PIN_AH18 ; QSF Assignment ;
; Location ; ; ; HEX6[0] ; PIN_AA17 ; QSF Assignment ;
; Location ; ; ; HEX6[1] ; PIN_AB16 ; QSF Assignment ;
; Location ; ; ; HEX6[2] ; PIN_AA16 ; QSF Assignment ;
; Location ; ; ; HEX6[3] ; PIN_AB17 ; QSF Assignment ;
; Location ; ; ; HEX6[4] ; PIN_AB15 ; QSF Assignment ;
; Location ; ; ; HEX6[5] ; PIN_AA15 ; QSF Assignment ;
; Location ; ; ; HEX6[6] ; PIN_AC17 ; QSF Assignment ;
; Location ; ; ; HEX7[0] ; PIN_AD17 ; QSF Assignment ;
; Location ; ; ; HEX7[1] ; PIN_AE17 ; QSF Assignment ;
; Location ; ; ; HEX7[2] ; PIN_AG17 ; QSF Assignment ;
; Location ; ; ; HEX7[3] ; PIN_AH17 ; QSF Assignment ;
; Location ; ; ; HEX7[4] ; PIN_AF17 ; QSF Assignment ;
; Location ; ; ; HEX7[5] ; PIN_AG18 ; QSF Assignment ;
; Location ; ; ; HEX7[6] ; PIN_AA14 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKIN0 ; PIN_AH15 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKIN_N1 ; PIN_J28 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKIN_N2 ; PIN_Y28 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKIN_P1 ; PIN_J27 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKIN_P2 ; PIN_Y27 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKOUT0 ; PIN_AD28 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKOUT_N1 ; PIN_G24 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKOUT_N2 ; PIN_V24 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKOUT_P1 ; PIN_G23 ; QSF Assignment ;
; Location ; ; ; HSMC_CLKOUT_P2 ; PIN_V23 ; QSF Assignment ;
; Location ; ; ; HSMC_D[0] ; PIN_AE26 ; QSF Assignment ;
; Location ; ; ; HSMC_D[1] ; PIN_AE28 ; QSF Assignment ;
; Location ; ; ; HSMC_D[2] ; PIN_AE27 ; QSF Assignment ;
; Location ; ; ; HSMC_D[3] ; PIN_AF27 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[0] ; PIN_F25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[10] ; PIN_U26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[11] ; PIN_L22 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[12] ; PIN_N26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[13] ; PIN_P26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[14] ; PIN_R21 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[15] ; PIN_R23 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[16] ; PIN_T22 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[1] ; PIN_C27 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[2] ; PIN_E26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[3] ; PIN_G26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[4] ; PIN_H26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[5] ; PIN_K26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[6] ; PIN_L24 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[7] ; PIN_M26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[8] ; PIN_R26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_N[9] ; PIN_T26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[0] ; PIN_F24 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[10] ; PIN_U25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[11] ; PIN_L21 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[12] ; PIN_N25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[13] ; PIN_P25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[14] ; PIN_P21 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[15] ; PIN_R22 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[16] ; PIN_T21 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[1] ; PIN_D26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[2] ; PIN_F26 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[3] ; PIN_G25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[4] ; PIN_H25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[5] ; PIN_K25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[6] ; PIN_L23 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[7] ; PIN_M25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[8] ; PIN_R25 ; QSF Assignment ;
; Location ; ; ; HSMC_RX_D_P[9] ; PIN_T25 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[0] ; PIN_D28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[10] ; PIN_J26 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[11] ; PIN_L28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[12] ; PIN_V26 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[13] ; PIN_R28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[14] ; PIN_U28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[15] ; PIN_V28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[16] ; PIN_V22 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[1] ; PIN_E28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[2] ; PIN_F28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[3] ; PIN_G28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[4] ; PIN_K28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[5] ; PIN_M28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[6] ; PIN_K22 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[7] ; PIN_H24 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[8] ; PIN_J24 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_N[9] ; PIN_P28 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[0] ; PIN_D27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[10] ; PIN_J25 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[11] ; PIN_L27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[12] ; PIN_V25 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[13] ; PIN_R27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[14] ; PIN_U27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[15] ; PIN_V27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[16] ; PIN_U22 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[1] ; PIN_E27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[2] ; PIN_F27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[3] ; PIN_G27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[4] ; PIN_K27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[5] ; PIN_M27 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[6] ; PIN_K21 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[7] ; PIN_H23 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[8] ; PIN_J23 ; QSF Assignment ;
; Location ; ; ; HSMC_TX_D_P[9] ; PIN_P27 ; QSF Assignment ;
; Location ; ; ; IRDA_RXD ; PIN_Y15 ; QSF Assignment ;
; Location ; ; ; IRDA_TXD ; PIN_AE24 ; QSF Assignment ;
; Location ; ; ; LCD_BLON ; PIN_L6 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[0] ; PIN_L3 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[1] ; PIN_L1 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[2] ; PIN_L2 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[3] ; PIN_K7 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[4] ; PIN_K1 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[5] ; PIN_K2 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[6] ; PIN_M3 ; QSF Assignment ;
; Location ; ; ; LCD_DATA[7] ; PIN_M5 ; QSF Assignment ;
; Location ; ; ; LCD_EN ; PIN_L4 ; QSF Assignment ;
; Location ; ; ; LCD_ON ; PIN_L5 ; QSF Assignment ;
; Location ; ; ; LCD_RS ; PIN_M2 ; QSF Assignment ;
; Location ; ; ; LCD_RW ; PIN_M1 ; QSF Assignment ;
; Location ; ; ; LEDG[0] ; PIN_E21 ; QSF Assignment ;
; Location ; ; ; LEDG[1] ; PIN_E22 ; QSF Assignment ;
; Location ; ; ; LEDG[2] ; PIN_E25 ; QSF Assignment ;
; Location ; ; ; LEDG[3] ; PIN_E24 ; QSF Assignment ;
; Location ; ; ; LEDG[4] ; PIN_H21 ; QSF Assignment ;
; Location ; ; ; LEDG[5] ; PIN_G20 ; QSF Assignment ;
; Location ; ; ; LEDG[6] ; PIN_G22 ; QSF Assignment ;
; Location ; ; ; LEDG[7] ; PIN_G21 ; QSF Assignment ;
; Location ; ; ; LEDG[8] ; PIN_F17 ; QSF Assignment ;
; Location ; ; ; LEDR[0] ; PIN_G19 ; QSF Assignment ;
; Location ; ; ; LEDR[10] ; PIN_J15 ; QSF Assignment ;
; Location ; ; ; LEDR[11] ; PIN_H16 ; QSF Assignment ;
; Location ; ; ; LEDR[12] ; PIN_J16 ; QSF Assignment ;
; Location ; ; ; LEDR[13] ; PIN_H17 ; QSF Assignment ;
; Location ; ; ; LEDR[14] ; PIN_F15 ; QSF Assignment ;
; Location ; ; ; LEDR[15] ; PIN_G15 ; QSF Assignment ;
; Location ; ; ; LEDR[16] ; PIN_G16 ; QSF Assignment ;
; Location ; ; ; LEDR[17] ; PIN_H15 ; QSF Assignment ;
; Location ; ; ; LEDR[1] ; PIN_F19 ; QSF Assignment ;
; Location ; ; ; LEDR[2] ; PIN_E19 ; QSF Assignment ;
; Location ; ; ; LEDR[3] ; PIN_F21 ; QSF Assignment ;
; Location ; ; ; LEDR[4] ; PIN_F18 ; QSF Assignment ;
; Location ; ; ; LEDR[5] ; PIN_E18 ; QSF Assignment ;
; Location ; ; ; LEDR[6] ; PIN_J19 ; QSF Assignment ;
; Location ; ; ; LEDR[7] ; PIN_H19 ; QSF Assignment ;
; Location ; ; ; LEDR[8] ; PIN_J17 ; QSF Assignment ;
; Location ; ; ; LEDR[9] ; PIN_G17 ; QSF Assignment ;
; Location ; ; ; NETCLK_25 ; PIN_A14 ; QSF Assignment ;
; Location ; ; ; OTG_ADDR[0] ; PIN_H7 ; QSF Assignment ;
; Location ; ; ; OTG_ADDR[1] ; PIN_C3 ; QSF Assignment ;
; Location ; ; ; OTG_CS_N ; PIN_A3 ; QSF Assignment ;
; Location ; ; ; OTG_DACK0_N ; PIN_C2 ; QSF Assignment ;
; Location ; ; ; OTG_DACK1_N ; PIN_B2 ; QSF Assignment ;
; Location ; ; ; OTG_DACK_N[0] ; PIN_C4 ; QSF Assignment ;
; Location ; ; ; OTG_DACK_N[1] ; PIN_D4 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[0] ; PIN_J6 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[10] ; PIN_G1 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[11] ; PIN_G2 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[12] ; PIN_G3 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[13] ; PIN_F1 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[14] ; PIN_F3 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[15] ; PIN_G4 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[1] ; PIN_K4 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[2] ; PIN_J5 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[3] ; PIN_K3 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[4] ; PIN_J4 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[5] ; PIN_J3 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[6] ; PIN_J7 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[7] ; PIN_H6 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[8] ; PIN_H3 ; QSF Assignment ;
; Location ; ; ; OTG_DATA[9] ; PIN_H4 ; QSF Assignment ;
; Location ; ; ; OTG_DREQ0 ; PIN_F6 ; QSF Assignment ;
; Location ; ; ; OTG_DREQ1 ; PIN_E5 ; QSF Assignment ;
; Location ; ; ; OTG_DREQ[0] ; PIN_J1 ; QSF Assignment ;
; Location ; ; ; OTG_DREQ[1] ; PIN_B4 ; QSF Assignment ;
; Location ; ; ; OTG_FSPEED ; PIN_C6 ; QSF Assignment ;
; Location ; ; ; OTG_INT0 ; PIN_B3 ; QSF Assignment ;
; Location ; ; ; OTG_INT1 ; PIN_C3 ; QSF Assignment ;
; Location ; ; ; OTG_INT[0] ; PIN_A6 ; QSF Assignment ;
; Location ; ; ; OTG_INT[1] ; PIN_D5 ; QSF Assignment ;
; Location ; ; ; OTG_LSPEED ; PIN_B6 ; QSF Assignment ;
; Location ; ; ; OTG_OE_N ; PIN_B3 ; QSF Assignment ;
; Location ; ; ; OTG_RD_N ; PIN_G2 ; QSF Assignment ;
; Location ; ; ; OTG_RST_N ; PIN_C5 ; QSF Assignment ;
; Location ; ; ; OTG_WE_N ; PIN_A4 ; QSF Assignment ;
; Location ; ; ; OTG_WR_N ; PIN_G1 ; QSF Assignment ;
; Location ; ; ; PS2_CLK ; PIN_D26 ; QSF Assignment ;
; Location ; ; ; PS2_DAT ; PIN_C24 ; QSF Assignment ;
; Location ; ; ; PS2_KBCLK ; PIN_G6 ; QSF Assignment ;
; Location ; ; ; PS2_KBDAT ; PIN_H5 ; QSF Assignment ;
; Location ; ; ; PS2_MSCLK ; PIN_G5 ; QSF Assignment ;
; Location ; ; ; PS2_MSDAT ; PIN_F5 ; QSF Assignment ;
; Location ; ; ; SD_CLK ; PIN_AE13 ; QSF Assignment ;
; Location ; ; ; SD_CMD ; PIN_AD14 ; QSF Assignment ;
; Location ; ; ; SD_DAT ; PIN_AD24 ; QSF Assignment ;
; Location ; ; ; SD_DAT3 ; PIN_AC23 ; QSF Assignment ;
; Location ; ; ; SD_DAT[0] ; PIN_AE14 ; QSF Assignment ;
; Location ; ; ; SD_DAT[1] ; PIN_AF13 ; QSF Assignment ;
; Location ; ; ; SD_DAT[2] ; PIN_AB14 ; QSF Assignment ;
; Location ; ; ; SD_DAT[3] ; PIN_AC14 ; QSF Assignment ;
; Location ; ; ; SD_WP_N ; PIN_AF14 ; QSF Assignment ;
; Location ; ; ; SMA_CLKIN ; PIN_AH14 ; QSF Assignment ;
; Location ; ; ; SMA_CLKOUT ; PIN_AE23 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[0] ; PIN_AB7 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[10] ; PIN_AF2 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[11] ; PIN_AD3 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[12] ; PIN_AB4 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[13] ; PIN_AC3 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[14] ; PIN_AA4 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[15] ; PIN_AB11 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[16] ; PIN_AC11 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[17] ; PIN_AB9 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[18] ; PIN_AB8 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[19] ; PIN_T8 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[1] ; PIN_AD7 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[2] ; PIN_AE7 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[3] ; PIN_AC7 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[4] ; PIN_AB6 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[5] ; PIN_AE6 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[6] ; PIN_AB5 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[7] ; PIN_AC5 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[8] ; PIN_AF5 ; QSF Assignment ;
; Location ; ; ; SRAM_ADDR[9] ; PIN_T7 ; QSF Assignment ;
; Location ; ; ; SRAM_CE_N ; PIN_AF8 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[0] ; PIN_AH3 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[10] ; PIN_AE2 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[11] ; PIN_AE1 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[12] ; PIN_AE3 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[13] ; PIN_AE4 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[14] ; PIN_AF3 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[15] ; PIN_AG3 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[1] ; PIN_AF4 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[2] ; PIN_AG4 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[3] ; PIN_AH4 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[4] ; PIN_AF6 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[5] ; PIN_AG6 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[6] ; PIN_AH6 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[7] ; PIN_AF7 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[8] ; PIN_AD1 ; QSF Assignment ;
; Location ; ; ; SRAM_DQ[9] ; PIN_AD2 ; QSF Assignment ;
; Location ; ; ; SRAM_LB_N ; PIN_AD4 ; QSF Assignment ;
; Location ; ; ; SRAM_OE_N ; PIN_AD5 ; QSF Assignment ;
; Location ; ; ; SRAM_UB_N ; PIN_AC4 ; QSF Assignment ;
; Location ; ; ; SRAM_WE_N ; PIN_AE8 ; QSF Assignment ;
; Location ; ; ; SW[10] ; PIN_AC24 ; QSF Assignment ;
; Location ; ; ; SW[11] ; PIN_AB24 ; QSF Assignment ;
; Location ; ; ; SW[12] ; PIN_AB23 ; QSF Assignment ;
; Location ; ; ; SW[13] ; PIN_AA24 ; QSF Assignment ;
; Location ; ; ; SW[14] ; PIN_AA23 ; QSF Assignment ;
; Location ; ; ; SW[15] ; PIN_AA22 ; QSF Assignment ;
; Location ; ; ; SW[16] ; PIN_Y24 ; QSF Assignment ;
; Location ; ; ; SW[17] ; PIN_Y23 ; QSF Assignment ;
; Location ; ; ; SW[4] ; PIN_AB27 ; QSF Assignment ;
; Location ; ; ; SW[5] ; PIN_AC26 ; QSF Assignment ;
; Location ; ; ; SW[6] ; PIN_AD26 ; QSF Assignment ;
; Location ; ; ; SW[7] ; PIN_AB26 ; QSF Assignment ;
; Location ; ; ; SW[8] ; PIN_AC25 ; QSF Assignment ;
; Location ; ; ; SW[9] ; PIN_AB25 ; QSF Assignment ;
; Location ; ; ; TCK ; PIN_D14 ; QSF Assignment ;
; Location ; ; ; TCS ; PIN_A14 ; QSF Assignment ;
; Location ; ; ; TDI ; PIN_B14 ; QSF Assignment ;
; Location ; ; ; TDO ; PIN_F14 ; QSF Assignment ;
; Location ; ; ; TD_CLK27 ; PIN_B14 ; QSF Assignment ;
; Location ; ; ; TD_DATA[0] ; PIN_E8 ; QSF Assignment ;
; Location ; ; ; TD_DATA[1] ; PIN_A7 ; QSF Assignment ;
; Location ; ; ; TD_DATA[2] ; PIN_D8 ; QSF Assignment ;
; Location ; ; ; TD_DATA[3] ; PIN_C7 ; QSF Assignment ;
; Location ; ; ; TD_DATA[4] ; PIN_D7 ; QSF Assignment ;
; Location ; ; ; TD_DATA[5] ; PIN_D6 ; QSF Assignment ;
; Location ; ; ; TD_DATA[6] ; PIN_E7 ; QSF Assignment ;
; Location ; ; ; TD_DATA[7] ; PIN_F7 ; QSF Assignment ;
; Location ; ; ; TD_HS ; PIN_E5 ; QSF Assignment ;
; Location ; ; ; TD_RESET ; PIN_C4 ; QSF Assignment ;
; Location ; ; ; TD_RESET_N ; PIN_G7 ; QSF Assignment ;
; Location ; ; ; TD_VS ; PIN_E4 ; QSF Assignment ;
; Location ; ; ; UART_CTS ; PIN_G14 ; QSF Assignment ;
; Location ; ; ; UART_RTS ; PIN_J13 ; QSF Assignment ;
; Location ; ; ; UART_RXD ; PIN_G12 ; QSF Assignment ;
; Location ; ; ; UART_TXD ; PIN_G9 ; QSF Assignment ;
; Location ; ; ; VGA_BLANK ; PIN_D6 ; QSF Assignment ;
; Location ; ; ; VGA_BLANK_N ; PIN_F11 ; QSF Assignment ;
; Location ; ; ; VGA_B[0] ; PIN_B10 ; QSF Assignment ;
; Location ; ; ; VGA_B[1] ; PIN_A10 ; QSF Assignment ;
; Location ; ; ; VGA_B[2] ; PIN_C11 ; QSF Assignment ;
; Location ; ; ; VGA_B[3] ; PIN_B11 ; QSF Assignment ;
; Location ; ; ; VGA_B[4] ; PIN_A11 ; QSF Assignment ;
; Location ; ; ; VGA_B[5] ; PIN_C12 ; QSF Assignment ;
; Location ; ; ; VGA_B[6] ; PIN_D11 ; QSF Assignment ;
; Location ; ; ; VGA_B[7] ; PIN_D12 ; QSF Assignment ;
; Location ; ; ; VGA_B[8] ; PIN_C12 ; QSF Assignment ;
; Location ; ; ; VGA_B[9] ; PIN_B12 ; QSF Assignment ;
; Location ; ; ; VGA_CLK ; PIN_A12 ; QSF Assignment ;
; Location ; ; ; VGA_G[0] ; PIN_G8 ; QSF Assignment ;
; Location ; ; ; VGA_G[1] ; PIN_G11 ; QSF Assignment ;
; Location ; ; ; VGA_G[2] ; PIN_F8 ; QSF Assignment ;
; Location ; ; ; VGA_G[3] ; PIN_H12 ; QSF Assignment ;
; Location ; ; ; VGA_G[4] ; PIN_C8 ; QSF Assignment ;
; Location ; ; ; VGA_G[5] ; PIN_B8 ; QSF Assignment ;
; Location ; ; ; VGA_G[6] ; PIN_F10 ; QSF Assignment ;
; Location ; ; ; VGA_G[7] ; PIN_C9 ; QSF Assignment ;
; Location ; ; ; VGA_G[8] ; PIN_E12 ; QSF Assignment ;
; Location ; ; ; VGA_G[9] ; PIN_D12 ; QSF Assignment ;
; Location ; ; ; VGA_HS ; PIN_G13 ; QSF Assignment ;
; Location ; ; ; VGA_R[0] ; PIN_E12 ; QSF Assignment ;
; Location ; ; ; VGA_R[1] ; PIN_E11 ; QSF Assignment ;
; Location ; ; ; VGA_R[2] ; PIN_D10 ; QSF Assignment ;
; Location ; ; ; VGA_R[3] ; PIN_F12 ; QSF Assignment ;
; Location ; ; ; VGA_R[4] ; PIN_G10 ; QSF Assignment ;
; Location ; ; ; VGA_R[5] ; PIN_J12 ; QSF Assignment ;
; Location ; ; ; VGA_R[6] ; PIN_H8 ; QSF Assignment ;
; Location ; ; ; VGA_R[7] ; PIN_H10 ; QSF Assignment ;
; Location ; ; ; VGA_R[8] ; PIN_F11 ; QSF Assignment ;
; Location ; ; ; VGA_R[9] ; PIN_E10 ; QSF Assignment ;
; Location ; ; ; VGA_SYNC ; PIN_B7 ; QSF Assignment ;
; Location ; ; ; VGA_SYNC_N ; PIN_C10 ; QSF Assignment ;
; Location ; ; ; VGA_VS ; PIN_C13 ; QSF Assignment ;
+----------+----------------+--------------+------------------+---------------+----------------+
+-------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+---------------------------+
; Resource ; Usage ;
+---------------------------------------------+---------------------------+
; Total logic elements ; 616 / 6,272 ( 10 % ) ;
; -- Combinational with no register ; 299 ;
; -- Register only ; 24 ;
; -- Combinational with a register ; 293 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 210 ;
; -- 3 input functions ; 204 ;
; -- <=2 input functions ; 178 ;
; -- Register only ; 24 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 418 ;
; -- arithmetic mode ; 174 ;
; ; ;
; Total registers* ; 317 / 6,684 ( 5 % ) ;
; -- Dedicated logic registers ; 317 / 6,272 ( 5 % ) ;
; -- I/O registers ; 0 / 412 ( 0 % ) ;
; ; ;
; Total LABs ; Not available ;
; Virtual pins ; 0 ;
; I/O pins ; 18 / 92 ( 20 % ) ;
; -- Clock pins ; 0 / 3 ( 0 % ) ;
; -- Dedicated input pins ; 0 / 9 ( 0 % ) ;
; ; ;
; Global signals ; 0 ;
; M9Ks ; 4 / 30 ( 13 % ) ;
; Total block memory bits ; 16,384 / 276,480 ( 6 % ) ;
; Total block memory implementation bits ; 36,864 / 276,480 ( 13 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 30 ( 0 % ) ;
; PLLs ; 1 / 2 ( 50 % ) ;
; Global clocks ; 0 / 10 ( 0 % ) ;
; JTAGs ; 0 / 1 ( 0 % ) ;
; CRC blocks ; 0 / 1 ( 0 % ) ;
; ASMI blocks ; 0 / 1 ( 0 % ) ;
; Oscillator blocks ; 0 / 1 ( 0 % ) ;
; Impedance control blocks ; 0 / 4 ( 0 % ) ;
; Maximum fan-out ; 516 ;
; Highest non-global fan-out ; 516 ;
; Total fan-out ; 5188 ;
; Average fan-out ; 4.81 ;
+---------------------------------------------+---------------------------+
* Register count does not include registers inside RAM blocks or DSP blocks.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------------+------------+----------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+-----------+
; Name ; Pin # ; I/O Bank ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination Control Block ; Location assigned by ; Slew Rate ;
+------------+------------+----------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+-----------+
; AUD_ADCDAT ; Unassigned ; -- ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; CLOCK_27 ; Unassigned ; -- ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; CLOCK_50 ; Unassigned ; -- ; 516 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; KEY[0] ; Unassigned ; -- ; 242 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; KEY[1] ; Unassigned ; -- ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; KEY[2] ; Unassigned ; -- ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; KEY[3] ; Unassigned ; -- ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; SW[0] ; Unassigned ; -- ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; SW[1] ; Unassigned ; -- ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; SW[2] ; Unassigned ; -- ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
; SW[3] ; Unassigned ; -- ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; None ; -- ; User ; no ;
+------------+------------+----------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+---------------------------+----------------------+-----------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+------------+------------+----------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+
; Name ; Pin # ; I/O Bank ; Output Register ; Output Enable Register ; Power Up High ; Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Termination Control Block ; Output Buffer Pre-emphasis ; Voltage Output Differential ; Location assigned by ; Output Enable Source ; Output Enable Group ;
+------------+------------+----------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+
; AUD_DACDAT ; Unassigned ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; None ; Default ; Off ; -- ; no ; no ; User ; - ; - ;
; AUD_XCK ; Unassigned ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; None ; Default ; Off ; -- ; no ; no ; User ; - ; - ;
; I2C_SCLK ; Unassigned ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; None ; Default ; Off ; -- ; no ; no ; User ; - ; - ;
+------------+------------+----------+-----------------+------------------------+---------------+-----------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+---------------------------+----------------------------+-----------------------------+----------------------+----------------------+---------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Bidir Pins ;
+-------------+------------+----------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------+-----------------+------------+----------+--------------+--------------+------------------+--------------------+---------------------------+----------------------------+----------------------+----------------------+----------------------------------+
; Name ; Pin # ; I/O Bank ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Output Enable Register ; Power Up High ; Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Output Termination ; Termination Control Block ; Output Buffer Pre-emphasis ; Location assigned by ; Output Enable Source ; Output Enable Group ;
+-------------+------------+----------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------+-----------------+------------+----------+--------------+--------------+------------------+--------------------+---------------------------+----------------------------+----------------------+----------------------+----------------------------------+
; AUD_ADCLRCK ; Unassigned ; -- ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; None ; Default ; Off ; -- ; no ; User ; 0 pF ; - ;
; AUD_BCLK ; Unassigned ; -- ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; None ; Default ; Off ; -- ; no ; User ; 0 pF ; - ;
; AUD_DACLRCK ; Unassigned ; -- ; 1 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; None ; Default ; Off ; -- ; no ; User ; 0 pF ; - ;
; I2C_SDAT ; Unassigned ; -- ; 3 ; 0 ; no ; no ; no ; no ; no ; no ; no ; yes ; no ; Off ; None ; Default ; Off ; -- ; no ; User ; 0 pF ; avconf:avc|I2C_Controller:u0|SDO ;
+-------------+------------+----------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------+-----------------+------------+----------+--------------+--------------+------------------+--------------------+---------------------------+----------------------------+----------------------+----------------------+----------------------------------+
+-----------------------------------------------------------------------------------+
; Dual Purpose and Dedicated Pins ;
+----------+-----------+-------------+------------------+---------------------------+
; Location ; Pin Name ; Reserved As ; User Signal Name ; Pin Type ;
+----------+-----------+-------------+------------------+---------------------------+
; 9 ; nSTATUS ; - ; - ; Dedicated Programming Pin ;
; 14 ; nCONFIG ; - ; - ; Dedicated Programming Pin ;
; 21 ; nCE ; - ; - ; Dedicated Programming Pin ;
; 92 ; CONF_DONE ; - ; - ; Dedicated Programming Pin ;
; 94 ; MSEL0 ; - ; - ; Dedicated Programming Pin ;
; 96 ; MSEL1 ; - ; - ; Dedicated Programming Pin ;
; 97 ; MSEL2 ; - ; - ; Dedicated Programming Pin ;
; 97 ; MSEL3 ; - ; - ; Dedicated Programming Pin ;
+----------+-----------+-------------+------------------+---------------------------+
+----------------------------------------------------------+
; I/O Bank Usage ;
+----------+----------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+----------------+---------------+--------------+
; 1 ; 0 / 11 ( 0 % ) ; -- ; -- ;
; 2 ; 0 / 8 ( 0 % ) ; -- ; -- ;
; 3 ; 0 / 11 ( 0 % ) ; -- ; -- ;
; 4 ; 0 / 14 ( 0 % ) ; -- ; -- ;
; 5 ; 0 / 13 ( 0 % ) ; -- ; -- ;
; 6 ; 0 / 10 ( 0 % ) ; -- ; -- ;
; 7 ; 0 / 13 ( 0 % ) ; -- ; -- ;
; 8 ; 0 / 12 ( 0 % ) ; -- ; -- ;
; Unknown ; 18 ; -- ; ;
+----------+----------------+---------------+--------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+---------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+---------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 0 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 2 ; 1 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 3 ; 2 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 4 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 5 ; ; ; VCCINT ; power ; ; ; -- ; ; -- ; -- ;
; 6 ; 5 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 7 ; 6 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; -- ; -- ;
; 8 ; 7 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 9 ; 9 ; 1 ; ^nSTATUS ; ; ; ; -- ; ; -- ; -- ;
; 10 ; 13 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 11 ; 14 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 12 ; 15 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; -- ; On ;
; 13 ; 16 ; 1 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 14 ; 17 ; 1 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; 15 ; 18 ; 1 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; 16 ; 19 ; 1 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; 17 ; ; 1 ; VCCIO1 ; power ; ; ; -- ; ; -- ; -- ;
; 18 ; 20 ; 1 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; 19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 20 ; 21 ; 1 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; 21 ; 22 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; 22 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 23 ; 24 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 24 ; 25 ; 2 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 25 ; 26 ; 2 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 26 ; ; 2 ; VCCIO2 ; power ; ; ; -- ; ; -- ; -- ;
; 27 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 28 ; 31 ; 2 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 29 ; ; ; VCCINT ; power ; ; ; -- ; ; -- ; -- ;
; 30 ; 34 ; 2 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 31 ; 36 ; 2 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; -- ; -- ;
; 32 ; 39 ; 2 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 33 ; 40 ; 2 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 34 ; 41 ; 2 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 35 ; ; -- ; VCCA1 ; power ; ; ; -- ; ; -- ; -- ;
; 36 ; ; ; GNDA1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 37 ; ; ; VCCD_PLL1 ; power ; ; ; -- ; ; -- ; -- ;
; 38 ; 45 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 39 ; 46 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 40 ; ; 3 ; VCCIO3 ; power ; ; ; -- ; ; -- ; -- ;
; 41 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 42 ; 52 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 43 ; 53 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 44 ; 54 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 45 ; ; ; VCCINT ; power ; ; ; -- ; ; -- ; -- ;
; 46 ; 58 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; -- ; -- ;
; 47 ; ; 3 ; VCCIO3 ; power ; ; ; -- ; ; -- ; -- ;
; 48 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 49 ; 68 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 50 ; 69 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 51 ; 70 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 52 ; 72 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 53 ; 73 ; 3 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 54 ; 74 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 55 ; 75 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 56 ; ; 4 ; VCCIO4 ; power ; ; ; -- ; ; -- ; -- ;
; 57 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 58 ; 80 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 59 ; 83 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 60 ; 84 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 61 ; ; ; VCCINT ; power ; ; ; -- ; ; -- ; -- ;
; 62 ; ; 4 ; VCCIO4 ; power ; ; ; -- ; ; -- ; -- ;
; 63 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 64 ; 89 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 65 ; 90 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; -- ; -- ;
; 66 ; 93 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 67 ; 94 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 68 ; 96 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 69 ; 97 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 70 ; 98 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 71 ; 99 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 72 ; 100 ; 4 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Column I/O ; ; no ; On ;
; 73 ; 102 ; 5 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 74 ; 103 ; 5 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 75 ; 104 ; 5 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 76 ; 106 ; 5 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 77 ; 107 ; 5 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; no ; On ;
; 78 ; ; ; VCCINT ; power ; ; ; -- ; ; -- ; -- ;
; 79 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 80 ; 113 ; 5 ; RESERVED_INPUT_WITH_WEAK_PULLUP ; ; ; ; Row I/O ; ; -- ; -- ;
; 81 ; ; 5 ; VCCIO5 ; power ; ; ; -- ; ; -- ; -- ;